Sandy Bridgeアーキテクチャ情報
Nehalem後継となるSandy Bridgeアーキテクチャ情報です。
http://www.canardpc.com/news-37333-canard_pc_vous_devoile_en_photo_le_futur_sandy_bridge_d___intel.html (仏語)
http://en.expreview.com/2009/07/06/intels-sandy-bridge-cpu-architecture-unveiled.html (英語概要)
これによると、Sandy Bridgeは新たなマイクロアーキテクチャとなり、6月にはすでにテープアウトしていたそうです。製造プロセスは引き続き32nmが使用されます。
Sandy BridgeではAES (Advanced Encryption Standard), Hyper-Threading, VMX (Virtualization Machine Extensions)に加え、AVX(Advanced Vector Extensions)もサポートされます。
Sandy Bridgeの各プロセッサコアのL2キャッシュサイズは256KBで、PCI Express 2.0コントローラを統合し、メモリはDDR3-1600まで対応します。TDPは85Wです。
製品構成としては6コアとL3キャッシュサイズが16MB, 8コアとL3キャッシュサイズが24MB, ローエンドでは2コアとなる予定です。要するに、対象市場に応じて2~8コアの製品を出すようです。動作周波数は2.8~3.4GHz, Turbo modeで3.8~4.0GHz、メインストリーム向けで3.0GHz程度になるとしています。
登場時期はQ1/2011が予定されています。リンク先にはメインストリーム向けSandy Bridgeのダイの図があり、これはA0 Steppingで4コア、統合されるグラフィックスコアのエンジンクロックは1.0~1.4GHz, L3キャッシュサイズは8MB, メモリはDDR3-1600の2チャネルとなっています。統合グラフィックスコアはDirectX 11世代で、性能は2011年のAMDとNVIDIAのエントリクラス程度の性能はあるとしています。
ちなみにソケットはマザーボードベンダの噂によると、Clarkdaleと同じLGA 1156が採用されるそうですが、チップセットは新規品が必要になるとのことです。
AVXについてはPC Watchの連載「後藤弘茂のWeekly海外ニュース」の2008年4月10日の記事に詳しいので、こちらも参照することをお勧めします。
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コメント
SandyBridge225m㎡ダイ画像のGPUコアは1/4以下に見えるので
仮に50m㎡とするとエントリGPU(100m㎡以下)のサイズの半分程度
それで性能は同レベルとなるとサイズあたりの性能が倍ということに
・・・夢見過ぎなんじゃないかと・・・
投稿: | 2009年7月 7日 (火) 11時25分
>・・・夢見過ぎなんじゃないかと・・・
ヒント
32nm
投稿: | 2009年7月 8日 (水) 07時54分
さらいうと、100mm2にはメモリーインターフェースも加えた数字だろうしね。
投稿: メモコンはどこへ行った | 2009年7月 8日 (水) 08時16分
エントリ(=ローエンド)にサイズや性能の加減は無いから
32nmのハーフで20mm2くらいのでも出せば辻褄合うかも
投稿: | 2009年7月 8日 (水) 10時21分
45nmプロセスで作られるMCMのArrandaleでも、G45のグラフィックス性能は3倍高いそうだから、Sandy Bridgeのグラフィックス性能は、それより更に2-3倍は高いとすれば、現行G45と比較すれば6-9倍にもなる。
少なくても今の790GX程度は遥かに上回るから、Intelがそれなり自慢しても良い位の性能ははあるんじゃないかな。
自社のCPUに組み込んで一緒に使ってもらうわけだから、それなりに力を入れてるだろうしね。
もっともこの頃には790GXなんかは大したこと無いんだろうけど。
投稿: 字万 | 2009年7月11日 (土) 21時49分
それくらいの性能だと3Dゲームもある程度プレイできるな
投稿: asd | 2009年7月15日 (水) 18時50分
統合GPUはプレステ3RSX(7600GT相当)以上の性能?
投稿: | 2009年9月 5日 (土) 10時38分
Sandy Bridgeの実行ユニット
Port0 ALU/MXX/SSE/AVX 256BitFP Mul
Port1 ALU/MMX/SSE/AVX 256BitFP Add
Port5 ALu/MMX/SSE/AVX 256BitFP shuffle
Port2 Load/Store
Port3 Load/Store
Port4 Store data
Nehalemの実行ユニット
Port0 ALU/MXX/SSE 128BitFP Mul
Port1 ALU/MMX/SSE 128BitFP Add
Port5 ALu/MMX/SSE 128BitFP shuffle
Port2 Load
Port3 Store
Port4 Store data
投稿: | 2009年9月25日 (金) 15時13分